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問(wèn)答題

【簡(jiǎn)答題】現(xiàn)代計(jì)算機(jī)中，SRAM一般用于實(shí)現(xiàn)快速小容量的cache，而DRAM用于實(shí)現(xiàn)慢速大容量的主存。以前超級(jí)計(jì)算機(jī)通常不提供cache，而是用SRAM來(lái)實(shí)現(xiàn)主存（如，Cray巨型機(jī)），請(qǐng)問(wèn)：如果不考慮成本，你還這樣設(shè)計(jì)高性能計(jì)算機(jī)嗎？為什么？

答案：不這樣做的理由主要有以下兩個(gè)方面：
①主存越大越好，主存大，缺頁(yè)率降低，因而減少了訪問(wèn)磁盤(pán)所需的時(shí)間。顯然用D...

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問(wèn)答題

【簡(jiǎn)答題】假定一個(gè)存儲(chǔ)器系統(tǒng)支持4體交叉存取，某程序執(zhí)行過(guò)程中訪問(wèn)地址序列為3，9，17，2，51，37，13，4，8，41，67，10，則哪些地址訪問(wèn)會(huì)發(fā)生體沖突？

答案：對(duì)于4體交叉訪問(wèn)的存儲(chǔ)系統(tǒng)，每個(gè)存儲(chǔ)模塊的地址分布為：
Bank0：0、4、8、12、16…&h...

問(wèn)答題

【簡(jiǎn)答題】某計(jì)算機(jī)中已配有0000H～7FFFH的ROM區(qū)域，現(xiàn)在再用8K×4位的RAM芯片形成32K×8位的存儲(chǔ)區(qū)域，CPU地址總線為A0-A15，數(shù)據(jù)總線為D0-D7，控制信號(hào)為R/W#（讀/寫(xiě)）、MREQ#（訪存）。要求說(shuō)明地址譯碼方案假定上述其他條件不變，只是CPU地址線改為24根，地址范圍000000H～007FFFH為ROM區(qū)，剩下的所有地址空間都用8K×4位的RAM芯片配置，則需要多少個(gè)這樣的RAM芯片？

答案： CPU地址線共16位，故存儲(chǔ)器地址空間為0000H～FFFFH，其中，8000H～FFFFH為RAM區(qū)，共215=32K...